update ulp implementation
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c38972b51c
@ -104,7 +104,7 @@ INC += \
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-isystem esp-idf/components/soc/include \
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-isystem esp-idf/components/soc/$(IDF_TARGET)/include \
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-isystem esp-idf/components/spi_flash/include \
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-isystem esp-idf/components/ulp/include \
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-isystem esp-idf/components/ulp/ulp_fsm/include \
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||||
-isystem esp-idf/components/ulp/ulp_riscv/include \
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||||
-isystem esp-idf/components/ulp/ulp_common/include \
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||||
-isystem esp-idf/components/ulp/ulp_common/include/$(IDF_TARGET) \
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@ -90,12 +90,14 @@ void common_hal_espulp_ulp_run(espulp_ulp_obj_t *self, uint32_t *program, size_t
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||||
ulp_set_wakeup_period(0, 20000);
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||||
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||||
switch (self->arch) {
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||||
#ifdef CONFIG_ULP_COPROC_TYPE_FSM
|
||||
case FSM:
|
||||
ulp_load_binary(0, (const uint8_t *)program, length);
|
||||
ulp_run(0);
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||||
break;
|
||||
#endif
|
||||
#ifdef CONFIG_ULP_COPROC_TYPE_RISCV
|
||||
case RISCV:
|
||||
#ifndef CONFIG_IDF_TARGET_ESP32
|
||||
ulp_riscv_load_binary((const uint8_t *)program, length);
|
||||
ulp_riscv_run();
|
||||
break;
|
||||
@ -107,12 +109,23 @@ void common_hal_espulp_ulp_run(espulp_ulp_obj_t *self, uint32_t *program, size_t
|
||||
}
|
||||
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||||
void common_hal_espulp_ulp_halt(espulp_ulp_obj_t *self) {
|
||||
#ifdef CONFIG_IDF_TARGET_ESP32
|
||||
mp_raise_NotImplementedError(NULL);
|
||||
#else
|
||||
switch (self->arch) {
|
||||
/*
|
||||
#ifdef CONFIG_ULP_COPROC_TYPE_FSM
|
||||
case FSM:
|
||||
break;
|
||||
#endif
|
||||
*/
|
||||
#ifdef CONFIG_ULP_COPROC_TYPE_RISCV
|
||||
case RISCV:
|
||||
ulp_riscv_timer_stop();
|
||||
ulp_riscv_halt();
|
||||
break;
|
||||
#endif
|
||||
default:
|
||||
mp_raise_NotImplementedError(NULL);
|
||||
break;
|
||||
}
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||||
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||||
// Release pins we were using.
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||||
for (uint8_t i = 0; i < 32; i++) {
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||||
@ -130,11 +143,19 @@ void common_hal_espulp_ulp_construct(espulp_ulp_obj_t *self, espulp_architecture
|
||||
mp_raise_ValueError_varg(translate("%q in use"), MP_QSTR_ULP);
|
||||
}
|
||||
|
||||
#ifdef CONFIG_IDF_TARGET_ESP32
|
||||
if (self->arch == RISCV) {
|
||||
mp_raise_NotImplementedError(NULL);
|
||||
}
|
||||
switch (self->arch) {
|
||||
#ifdef CONFIG_ULP_COPROC_TYPE_FSM
|
||||
case FSM:
|
||||
break;
|
||||
#endif
|
||||
#ifdef CONFIG_ULP_COPROC_TYPE_RISCV
|
||||
case RISCV:
|
||||
break;
|
||||
#endif
|
||||
default:
|
||||
mp_raise_NotImplementedError(NULL);
|
||||
break;
|
||||
}
|
||||
|
||||
self->arch = arch;
|
||||
self->inited = true;
|
||||
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@ -81,17 +81,19 @@ void espulp_ulpalarm_set_alarm(const bool deep_sleep, const size_t n_alarms, con
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||||
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||||
// enable ulp interrupt
|
||||
switch (alarm->ulp->arch) {
|
||||
#ifdef CONFIG_ULP_COPROC_TYPE_FSM
|
||||
case FSM:
|
||||
#ifdef CONFIG_IDF_TARGET_ESP32
|
||||
rtc_isr_register(&ulp_interrupt, NULL, RTC_CNTL_ULP_CP_INT_RAW);
|
||||
rtc_isr_register(&ulp_interrupt, NULL, RTC_CNTL_ULP_CP_INT_RAW, 0);
|
||||
#else
|
||||
rtc_isr_register(&ulp_interrupt, NULL, RTC_CNTL_ULP_CP_INT_ST);
|
||||
rtc_isr_register(&ulp_interrupt, NULL, RTC_CNTL_ULP_CP_INT_ST, 0);
|
||||
#endif
|
||||
REG_SET_BIT(RTC_CNTL_INT_ENA_REG, RTC_CNTL_ULP_CP_INT_ENA);
|
||||
break;
|
||||
#endif
|
||||
#ifdef CONFIG_ULP_COPROC_TYPE_RISCV
|
||||
case RISCV:
|
||||
#ifndef CONFIG_IDF_TARGET_ESP32
|
||||
rtc_isr_register(&ulp_interrupt, NULL, RTC_CNTL_COCPU_INT_ST);
|
||||
rtc_isr_register(&ulp_interrupt, NULL, RTC_CNTL_COCPU_INT_ST, 0);
|
||||
REG_SET_BIT(RTC_CNTL_INT_ENA_REG, RTC_CNTL_COCPU_INT_ENA);
|
||||
break;
|
||||
#endif
|
||||
@ -110,8 +112,10 @@ void espulp_ulpalarm_prepare_for_deep_sleep(void) {
|
||||
|
||||
// disable ulp interrupt
|
||||
rtc_isr_deregister(&ulp_interrupt, NULL);
|
||||
#ifdef CONFIG_ULP_COPROC_TYPE_FSM
|
||||
REG_CLR_BIT(RTC_CNTL_INT_ENA_REG, RTC_CNTL_ULP_CP_INT_ENA);
|
||||
#ifndef CONFIG_IDF_TARGET_ESP32
|
||||
#endif
|
||||
#ifdef CONFIG_ULP_COPROC_TYPE_RISCV
|
||||
REG_CLR_BIT(RTC_CNTL_INT_ENA_REG, RTC_CNTL_COCPU_INT_ENA);
|
||||
#endif
|
||||
|
||||
|
@ -7,5 +7,4 @@ CONFIG_ESP32S2_DATA_CACHE_16KB=y
|
||||
CONFIG_ESP32S2_RTCDATA_IN_FAST_MEM=y
|
||||
|
||||
CONFIG_ULP_COPROC_ENABLED=y
|
||||
CONFIG_ULP_COPROC_TYPE_RISCV=y
|
||||
CONFIG_ULP_COPROC_RESERVE_MEM=8176
|
||||
|
@ -8,5 +8,4 @@ CONFIG_ESP_MAIN_TASK_AFFINITY_CPU1=y
|
||||
CONFIG_ESP32S3_RTCDATA_IN_FAST_MEM=y
|
||||
|
||||
CONFIG_ULP_COPROC_ENABLED=y
|
||||
CONFIG_ULP_COPROC_TYPE_RISCV=y
|
||||
CONFIG_ULP_COPROC_RESERVE_MEM=8176
|
||||
|
@ -48,8 +48,6 @@ CIRCUITPY_WIFI ?= 1
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||||
ifeq ($(IDF_TARGET),esp32)
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||||
# Modules
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||||
CIRCUITPY_BLEIO = 0
|
||||
CIRCUITPY_ESPULP = 0
|
||||
CIRCUITPY_MEMORYMAP = 0
|
||||
CIRCUITPY_PARALLELDISPLAY = 0
|
||||
CIRCUITPY_RGBMATRIX = 0
|
||||
# Features
|
||||
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